矽光子（Silicon Photonics）新創企業 Ayar Labs 於 2026 年初宣布，將其年度募資總額大幅擴張至 6.5 億美元，創下該公司歷來單輪最大手筆。這筆資金將全數投入「共同封裝光學」（Co-Packaged Optics, CPO）技術的量產化工程，目標是讓光訊號直接在 AI 加速器（如 GPU）封裝內部傳輸，徹底突破傳統銅線與可插拔光模組（Pluggable Transceiver）的頻寬瓶頸與功耗天花板。
這是矽光子產業從「實驗室驗證」邁向「晶圓廠級量產」的關鍵分水嶺。 隨著 NVIDIA Blackwell、AMD MI 系列等高階 AI 晶片的單晶片功耗突破 700W、單晶片頻寬需求上看數 TB/s，傳統銅互連（Copper Interconnect）的物理極限已近在咫尺，訊號完整性與散熱成本呈指數級惡化。
Ayar Labs 透過將微縮化的「光引擎」（Optical Engine）以 Chiplet 形式與運算晶片共封於同一基板上，可在維持極低延遲的前提下，將頻寬密度提升 5 至 10 倍，同時顯著降低每 bit 傳輸功耗。此次 6.5 億美元募資的核心戰略意圖，正是要在 2027 至 2028 年超大規模 AI 機房擴張週期全面引爆之前，提前卡位 CPO 量產供應鏈。
這場技術變革背後，本質上是半導體與光電產業百年來最深刻的一場「典範轉移」，其技術演進脈絡與結構性誘因值得深入拆解。
一、銅線物理極限的逼近與訊號完整性危機
過去三十年，資料中心的「骨幹傳輸」歷經銅線（Copper）、可插拔光模組（Pluggable Optics）兩大革命。1990 年代 GbE 時代銅線稱霸，2010 年代後 10G/25G/100G 光模組成為主流。然而進入 AI 算力爆發期，NVIDIA H100、B200 等 GPU 透過 NVLink 與 NVSwitch 構成的「單一訓練叢集」規模動輒數萬顆 GPU，對單機櫃頻寬的需求已突破數十 TB/s。銅線在如此高頻寬下的訊號衰減與串擾（Crosstalk）已達物理極限，且功耗占整體資料中心 PUE 的比重飆升至 15% 以上，這迫使業界必須尋求根本性的互連架構變革。
二、CPO 取代可插拔模組的產業結構性轉型
傳統可插拔光模組（如 QSFP-DD、OSFP）雖具備高度彈性，但其在機櫃面板上佔據大量空間，且每次訊號轉換都需經過 SerDes（串列器／解串列器）多次光電轉換，效率低落。CPO 架構透過將光元件直接封裝於交換器 ASIC 或 AI 加速器旁，可減少 30% 至 50% 的功耗，並將 I/O 密度提升一個量級。Ayar Labs 的技術核心是採用「波長分波多工」（WDM）技術，讓單一光纖可承載多個波長，進一步提升頻寬密度。這項變革的本質，是從「外掛式」走向「內建式」的系統級整合，工程複雜度與供應鏈重塑難度都達到產業前所未有的高度。
三、從實驗室到晶圓廠：製程整合的生死關卡
矽光子的量產化始終面臨「製程鴻溝」：光元件與 CMOS 製程的整合良率低、封裝散熱路徑複雜、測試成本高昂。Ayar Labs 此次募資的重要用途，便是與 GlobalFoundries 等晶圓代工廠合作，導入 45nm RF-CMOS 製程平台，目標是將光元件良率從目前的 60% 至 70% 區間，推升至 95% 以上的量產水準。這是 CPO 能否從「樣品展示」走向「規模出貨」的最後一哩路，也是為何本輪募資金額必須拉高至 6.5 億美元的結構性原因。
戰略貿易流向與供應鏈依賴度
HS 8542資料來源：UN Comtrade 聯合國商品貿易統計庫 · 全球市場規模 $5,800 億美元 / 年
回顧半導體產業史，每一次互連技術的典範轉移（如 1990 年代從匯流排走向點對點、2010 年代從銅走向光）都重塑了產業版圖。Ayar Labs 此輪 6.5 億美元募資，可類比 2016 年 NVIDIA 押注 NVLink 的關鍵節點——當時看似瘋狂，卻奠定了今日 NVIDIA 在 AI 運算的霸主地位。基於此歷史對照，未來發展可分為以下三種情境：
無論哪種情境成真，2026 至 2030 年將是 CPO 技術從「邊緣實驗」走向「主流標準」的關鍵五年，整個半導體產業的價值鏈將被徹底重構。
面對 CPO 技術即將引爆的典範轉移，產業參與者應採行以下具體行動策略：
01 起因觸發：AI晶片單晶片功耗突破700W，銅互連物理極限逼近
02 一階傳導：Ayar Labs宣布6.5億美元募資，全面押注CPO量產
03 二階擴散：矽光子製程整合加速，光通訊設備廠與封測業者迎來訂單轉換潮
04 三階擴散：NVIDIA、AMD等AI晶片廠商啟動CPO相容性設計，光模組供應鏈重新洗牌
05 宏觀終局：全球AI資料中心PUE顯著下降，AI算力單位成本於2028年後進入下行週期
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