美國矽谷光通訊新創企業Ayar Labs宣布完成1.5億美元的新一輪增資，將資金用於加速其「光學I/O（Optical I/O）」解決方案的商業化，目標是讓光通訊技術直接內建於AI加速器與高效能運算（HPC）晶片封裝內部，徹底取代傳統銅線與傳統可插拔光模組的資料傳輸瓶頸。
此輪增資延續Ayar Labs在矽光子（Silicon Photonics）領域的長期佈局，主要投資人陣容涵蓋多家半導體與科技產業巨擘的策略投資部門，反映出資方對「晶片內光互連」將成為下一代AI基礎設施核心環節的強烈共識。這筆資金的戰略意義在於，Ayar Labs正試圖將光學鏈路從「機櫃外層（rack-level）」推進至「封裝內層（in-package）」，直接解決AI叢集規模化時遭遇的頻寬牆（Bandwidth Wall）與功耗牆（Power Wall）問題。
隨著NVIDIA、AMD、Google等晶片設計商持續將單一封裝內的GPU/HBM容量推向極限，晶片之間、晶片與記憶體之間的互連頻寬已成為決定AI系統整體吞吐量（TPS）的關鍵瓶頸。Ayar Labs以「共同封裝光學（Co-Packaged Optics, CPO）」為核心技術主張，試圖在這個典範轉移的轉折點上，搶占下一代AI資料中心的關鍵基礎設施話語權。
這場光通訊革命的背後，是一場多方勢力對「AI基礎設施底層技術標準定義權」的激烈爭奪。事件本質並非單純的技術升級，而是涉及半導體產業鏈重塑、資本市場估值重估與國家級科技競爭的深層博弈。
從技術演進脈絡來看，銅線互連在資料速率突破50Gbps後，面臨訊號衰減、距離受限與功耗急劇攀升的物理極限。傳統的可插拔光模組雖解決了距離問題，但每個模組仍需消耗可觀的電力進行光電轉換，在AI叢集動輒數千顆加速器規模下，可插拔模組的功耗成本已佔據資料中心總能耗的不可忽視比例。Ayar Labs所推動的「光學I/O」方案，意圖將光電轉換元件直接嵌入晶片封裝基板，從根本上縮短電訊號路徑、降低每bit傳輸能耗，並將頻寬密度提升至傳統銅線方案的數倍以上。
在產業競爭格局上，傳統光通訊巨頭如Broadcom、Marvell與Coherent已透過收購與自研，在可插拔模組與早期CPO領域建立先發優勢；台積電與Intel則從製程端切入矽光子代工。而NVIDIA則透過NVLink、InfiniBand與Spectrum-X自有生態系，傾向走「主控端整合」路線，對外購光互連方案保持策略性開放。Ayar Labs的特殊定位在於其「中立供應商」角色——不與任何晶片設計商競爭，純粹提供光學I/O IP與小晶片（chiplet），這使其同時具備被多個陣營採用的可能性，但也意味著必須在每一場技術標準會議中證明其方案的互通性與量產成熟度。
從資本面觀察，本輪1.5億美元的增資金額，對比AI基礎設施新創如Groq、Cerebras、Rain AI動輒數十億美元的募資規模看似保守，但實則反映光互連領域已從「純研發燒錢」階段邁入「產品認證與客戶導入」階段。投資方對「何時能看見第一筆量產營收」的關注度，將遠高於技術願景的華麗程度。
戰略貿易流向與供應鏈依賴度
HS 8542資料來源：UN Comtrade 聯合國商品貿易統計庫 · 全球市場規模 $5,800 億美元 / 年
回顧半導體產業的重大典範轉移歷史，每一次互連技術的突破都伴隨著長達五至十年的陣痛期與陣營重組。從1990年代PCI匯流排到PCIe的過渡、2010年代SATA到NVMe的典範轉移，再到今日從銅線到光互連的躍遷，技術標準的確立往往不是由最優技術勝出，而是由「最早建立生態系、最快進入量產」的方案主導。
面對這場光通訊典範轉移的不同情境疊加，無論是技術決策者或資本配置者，皆應採取「雙軌並行」的彈性策略，避免單一押注造成結構性風險。
01 起因觸發：AI模型參數量指數級增長，GPU間互連頻寬成為物理瓶頸
02 一階傳導：傳統可插拔光模組功耗過高，光學I/O小晶片成為替代方案焦點
03 二階擴散：矽光子製程需求湧現，台積電等Foundry的矽光子產能進入戰略擴張期
04 產業重塑：光通訊巨頭與晶片設計商加速CPO併購與自研，AI資料中心供應鏈重組
05 宏觀終局：2028年前後AI基礎設施互連架構完成世代交替，光互連成為新一代AI晶片的標配
跨事件因果網路圖譜 4 驗證節點
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