三星電子與荷蘭半導體設備巨擘ASML於日前宣布，將雙方逾十年的EUV微影合作關係，正式擴展至High-NA EUV（高數值孔徑極紫外光微影）及次世代光罩（photomask）解決方案。根據協議，三星將協助ASML共同開發專為High-NA EUV量身打造的12吋次世代光罩平台，取代業界沿用已久的6吋規格，以提升先進製程的圖案化效率並降低製程複雜度。
此次合作的核心戰略目標，是為AI驅動的高效能運算晶片提供更精密的電路圖案蝕刻能力。High-NA EUV被業界視為繼現有EUV之後的下一個重大典範轉移，ASML為目前全球唯一有能力量產商用EUV微影設備的供應商，其系統已成為全球先進晶片供應鏈中不可或缺的戰略環節。三星則計劃將此技術導入未來的DRAM量產，特別是用於AI基礎設施中日益關鍵的HBM（高頻寬記憶體）領域。
三星電子副會長兼執行長全永鉉強調：「AI時代正徹底重塑半導體產業，全價值鏈的技術創新重要性與日俱增。」ASML總裁兼執行長Christophe Fouquet亦回應，與客戶的緊密協作在嶄新技術競爭階段中將更形關鍵。
此事件本質並非傳統意義上的政治或商業對抗性衝突，而是屬於半導體先進製程演進中的技術聯盟深化，因此本文不適合以「利益角力」的角度生搬硬套，而應從產業技術演進的歷史脈絡與結構性誘因切入分析。
第一、EUV技術的歷史演進脈絡。 EUV微影技術從1990年代的理論構想，到2010年代正式進入量產，被譽為摩爾定律延續的關鍵突破。ASML歷經近30年的研發投入，是目前全球唯一能供應商用EUV微影設備的廠商，三星與台積電是最早採用EUV的晶圓代工與記憶體大廠。High-NA EUV則是在既有EUV基礎上提升數值孔徑，從0.33提升至0.55，使解析度可微縮至更先進節點，是突破傳統微影物理極限的下一里路。
第二、結構性誘發成因：AI需求驅動的製程競賽。 生成式AI引爆的高效能運算需求，使得HBM、先進邏輯晶片（如2奈米以下）的製造難度急劇攀升。傳統6吋光罩已難以承載更精密的電路圖案，12吋光罩平台是兼顧良率提升與成本下降的必然演進，三星與ASML的共同開發，象徵設備商與晶片製造商在前段製程共同承擔研發風險的「共創模式」日益深化。
第三、深層產業意涵：垂直整合與供應鏈綁定。 半導體產業鏈長期以來存在高度專業分工，但High-NA EUV的開發成本與技術門檻過於高昂，單一企業難以獨力負擔。三星透過與ASML的深度綁定，不僅是採購關係，更是共同定義次世代製程規格的策略聯盟，這也意味著三星在與台積電的先進製程競賽中，試圖透過「地緣夥伴關係」強化其技術話語權與供應優先權。
國際制裁與出口管制警報
🟠 高度管制 (HIGH RISK)資料來源：OpenSanctions / Dutch Export Control
⚠️ 合規與地緣風險要點： 荷蘭政府與美國協議管制 Twinscan NXT:1970i/1980i 等浸潤式 DUV 及全部 EUV 光刻機向特定受限制國家出口與維修授權。
戰略貿易流向與供應鏈依賴度
HS 8542資料來源：UN Comtrade 聯合國商品貿易統計庫 · 全球市場規模 $5,800 億美元 / 年
回顧半導體製程從ArF浸潤式（193奈米）走向EUV（13.5奈米），再到High-NA EUV的歷史軌跡，每一次典範轉移都伴隨長達5至10年的過渡陣痛期。當前High-NA EUV仍處於「導入初期」，單小時產出晶圓數（wafer per hour, WPH）仍低於傳統EVL。以下為未來12至36個月的三種情境推演：
面對半導體先進製程的典範轉移，各利害關係人應採取以下行動決策：
01 起因觸發：AI運算需求飆升驅動HBM與先進邏輯製程微縮壓力
02 一階傳導：ASML與三星簽署High-NA EUV及12吋光罩共同開發協議
03 二階擴散：光罩供應商（Toppan、DNP）、EUV防護膜與CMP耗材鏈迎來規格升級潮
04 三階擴散：SK海力士、台積電加速調整HBM4與A14製程藍圖應對三星卡位
05 宏觀終局：半導體先進製程進入「設備-晶片廠共創」新紀元，地緣供應鏈綁定加劇
跨事件因果網路圖譜 4 驗證節點
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從預測到兌現：代理型AI跨越產業典範轉移臨界點
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